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* System_Init.c
*
* Created on: 2018年6月8日
* Author: Limerrence
* 使用說明：調(diào)用DCO_Init()對始終系統(tǒng)進(jìn)行初始化，
* 設(shè)置XT的值可以選擇晶振，默認(rèn)選擇XT1，以降低功耗，
* 若對時鐘頻率要求較高可以選擇XT2，修改DCO_Init()函數(shù)中的值可以選擇不同的時鐘頻率
*/
#include <System_Init.h>
#define XT 1
/*********************************************************************
* 晶振選擇，XT為1時選擇XT1做時鐘源，XT為2時選擇XT2做時鐘源
* 若選XT1,則最終MCLK:24MHZ,SMCLK:12MHZ,ACLK:32768HZ
* 若選XT2,則最終MCLK:24MHZ,SMCLK:12MHZ,ACLK:4MHZ
*********************************************************************/
void SetVcore (unsigned int level)
{
PMMCTL0_H = PMMPW_H;
SVSMHCTL = SVSHE + SVSHRVL0 * level + SVMHE + SVSMHRRL0 * level;
SVSMLCTL = SVSLE + SVMLE + SVSMLRRL0 * level;
while ((PMMIFG & SVSMLDLYIFG) == 0);
PMMIFG &= ~(SVMLVLRIFG + SVMLIFG);
PMMCTL0_L = PMMCOREV0 * level;
if ((PMMIFG & SVMLIFG))
while ((PMMIFG & SVMLVLRIFG) == 0);
SVSMLCTL = SVSLE + SVSLRVL0 * level + SVMLE + SVSMLRRL0 * level;
PMMCTL0_H = 0x00;
}
#if (XT==1)
void DCO_Init()
{
P7SEL |= BIT7; //MCLK
P7DIR |= BIT7;
P5SEL |= BIT4|BIT5;
UCSCTL6 |= XCAP_3;
UCSCTL6 &= ~XT1OFF; //打開XT1，否則XT1LFOFFG可能報錯
SetVcore(1);
SetVcore(2);
SetVcore(3); //提高Vcore電壓到最高級，以滿足倍頻需求該函數(shù)位于HAL_PMM.H中
__bis_SR_register(SCG0); //該語法為固定格式，意為將括號內(nèi)的變量置位，SCG0與系統(tǒng)工作模式有關(guān)，此時MCLK暫停工作
UCSCTL0 = 0; //先清零，F(xiàn)LL運行時，該寄存器系統(tǒng)會自動配置，不用管
UCSCTL1 = DCORSEL_6;
/**************************************************************************
* 以下是對倍頻的設(shè)置
* //n=1,FLLREFCLK時鐘源為XT2CLK;
* //DCOCLK=D*(N+1)*(FLLREFCLK/n)=2*(3)*4M=24M;
* //DCOCLKDIV=(N+1)*(FLLREFCLK/n)=12M;
**************************************************************************/
UCSCTL2 = FLLD_1 | 380; //FLLD=1,FLLN=380,則頻率為2*（380+1）*32.768=24.969MHZ
__bic_SR_register(SCG0);
__delay_cycles(782000); //系統(tǒng)自帶的精確延時，單位us
while (SFRIFG1 & OFIFG)
{
UCSCTL7 &= ~(XT2OFFG + XT1LFOFFG + DCOFFG);
SFRIFG1 &= ~OFIFG;
}
UCSCTL4 = UCSCTL4&(~(SELS_7|SELM_7))|SELS_4|SELM_3;
//最終MCLK:24MHZ,SMCLK:12MHZ,ACLK:32768HZ
}
#endif
#if (XT==2)
void DCO_Init()
{
P7DIR |= BIT7;
P7SEL |= BIT7; //MCLK
P5SEL |= BIT2|BIT3; //打開XT2引腳
//UCSCTL6 |= XCAP_3;
UCSCTL6 &= XT1OFF; //關(guān)閉XT1
UCSCTL6 &= ~XT2OFF; //打開XT2
SetVcore(1);
SetVcore(2);
SetVcore(3); //提高Vcore電壓到最高級，以滿足倍頻需求該函數(shù)位于HAL_PMM.H中
/*********************寄存器配置部分******************************/
__bis_SR_register(SCG0); //該語法為固定格式，意為將括號內(nèi)的變量置位，
//SCG0與系統(tǒng)工作模式有關(guān)，此時MCLK暫停工作
//UCSCTL0 = DCO0+DCO1+DCO2+DCO3+DCO4;
UCSCTL0 = 0;
UCSCTL1 = DCORSEL_6; //DCO頻率范圍在28.2MHZ以下
UCSCTL2 = FLLD_1 + 2; //D=2，N=2
UCSCTL3 = SELREF_6 + FLLREFDIV_0; //n=1,FLLREFCLK時鐘源為XT2CLK;
//DCOCLK=D*(N+1)*(FLLREFCLK/n)=2*(3)*4M=24M;
//DCOCLKDIV=(N+1)*(FLLREFCLK/n)=12M;
UCSCTL4 = SELA_5 + SELS_4 + SELM_3; //ACLK的時鐘源為XT2,MCLK\SMCLK的時鐘源為DCOCLK
UCSCTL5 = DIVA_0 + DIVS_0 + DIVM_0; //ACLK由DCOCLKDIV的32分頻得到，SMCLK由DCOCLK的2分頻得到
//最終MCLK:24MHZ,SMCLK:12MHZ,ACLK:4MHZ
__bic_SR_register(SCG0); //Enable the FLL control loop
/**********************************************************************/
__delay_cycles(8192);
do
{
UCSCTL7 &= ~(XT2OFFG + XT1LFOFFG + DCOFFG); //Clear XT2,XT1,DCO fault flags
SFRIFG1 &= ~OFIFG; //Clear fault flags
}while (SFRIFG1&OFIFG);
}
#endif

復(fù)制代碼

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